华为扔出一颗“折叠”芯片，台积电3nm工艺被它用另一种方式追平了

距离华为Mate 90系列发布还有不到一个月，关于那颗新麒麟芯片的讨论已经炸了锅。

这次的核心看点不是什么新制程、新光刻机，而是一项叫做“逻辑折叠”的技术。

博主定焦数码最近指出，在应用逻辑折叠技术之前，华为麒麟芯片的等效晶体管密度跟台积电5nm基本相当。引入逻辑折叠之后，水平直接拉到了台积电第一代3nm的水准，甚至可能更强。

这意味着什么？在没有拿到最先进光刻机的情况下，华为靠架构创新硬生生把芯片性能提上去了。

一、逻辑折叠到底是什么？说白了就是把芯片从“平铺”变成“叠放”

传统的芯片提升性能，靠的是把晶体管做得越来越小。这条路走了几十年，也就是大家熟悉的摩尔定律。

但问题在于，这条路快走到头了。7纳米之后，继续缩小晶体管的成本暴涨，收益却在递减。一颗先进芯片的设计预算超过10亿美元，单位晶体管成本也不再下降。

华为走了一条不一样的路。

今年5月，华为半导体业务部总裁何庭波在国际电路与系统研讨会上正式发布了“韬（τ）定律”。核心思路很简单：不再死磕“把晶体管做小”，而是想办法“把信号传输时间缩短”。

逻辑折叠就是实现这个思路的关键技术。

它把原本平铺在二维平面上的电路，通过三维立体折叠和垂直互连“堆叠”起来。从单层平面布局变成了双层垂直堆叠。这样做的好处是：关键路径的走线长度大幅缩短，信号传播的电阻和电容负载也降低了。

打个比方：以前芯片设计像在一张纸上画电路，现在可以把电路折起来，上下两层叠在一起，信号走的路短了，速度自然就快了。

二、实测数据摆在这里：密度暴涨53.5%，功耗直降41%

理论说得再好，得看实际效果。

何庭波7月3日发布了韬定律的V2版论文，首次公开了麒麟2026芯片的实测数据。

跟上一代麒麟9030 Pro相比，麒麟2026的晶体管密度从155MTr/mm²提升到了238MTr/mm²，暴涨了53.5%。

这个提升幅度，按照传统路线需要三年才能实现。

每平方毫米可以集成2.38亿个晶体管，理论上跟Intel 18A工艺持平，接近初代台积电3nm的水平。

不止是密度。在同等性能下，麒麟2026的功耗降低了41%。工作电压从1.1伏降到了0.9伏。芯片面积缩小了37.5%。主频提升到了3.1GHz，涨幅超过12%。

这些提升全部来自架构的改变，没有用任何新的光刻工艺。

三、产业影响：一条绕过制程封锁的新路

这件事对整个中国芯片产业的意义，怎么强调都不过分。

过去几年，中国芯片产业最大的痛点是拿不到最先进的EUV光刻机。制程工艺被卡在某个节点上不去，性能就很难突破。

逻辑折叠技术提供了一条全新的路径——不依赖更先进的光刻机，靠架构创新和系统优化来实现性能越级。

华为过去六年已经基于这条路径设计并量产了381款芯片，覆盖手机、AI、汽车、工业等领域。

短期来看，这条路线直接带动了国内半导体材料、制造、封测等上下游企业。招商证券的研报指出，逻辑折叠技术将拉动镀铜、CMP、混合键合设备等需求。先进封装、EDA工具、半导体设备这些赛道都直接受益。

长期来看，华为这套技术方案给国内芯片设计企业提供了一条规避先进制程受限风险的新思路。

根据华为的规划，到2031年，基于韬定律的高端芯片晶体管密度将达到等效1.4纳米制程的水平。

四、行业怎么看？有人兴奋，有人冷静

市场反应很直接。韬定律发布当天，A股半导体板块整体大涨，封装、Chiplet、互连、HBM相关股票全面拉升。

大和证券发布报告说，华为这次发布带来了“正面惊喜”，显示在设计与制造环节已经取得了突破。

但行业里也有不同的声音。

英伟达CEO黄仁勋的看法是：这对华为是突破，但对台积电不是威胁。他认为台积电在3D封装和芯片堆叠技术上领先了10年。

这个判断有道理，但也需要放在具体语境里看。台积电的领先是客观事实，但华为的意义在于——在被限制使用最先进制程的情况下，找到了一条能持续迭代的可行路径。

何庭波自己也很清醒。她在论文里写道：“将τ缩放描述为一个已完成的系统会具有误导性”。工具链、方法论、晶圆间工艺变化、垂直互连开销，这些问题都还没有完全解决。未来十年的工作范围已经明确，但很多问题不是一家企业能单独解决的。

五、9月见分晓

下个月，华为Mate 90系列将正式发布，首发搭载这颗基于韬定律的麒麟芯片。据说还会有一个专门配了主动散热模块的“风驰版”，要把这颗芯片的全部性能释放出来。

这颗芯片到底能不能打，最终要看真机实测。 跑分是一回事，日常使用的流畅度、发热控制、续航表现是另一回事。

但不管最终结果如何，逻辑折叠技术本身已经打开了芯片行业一个新的思考方向——在制程工艺逼近物理极限的今天，也许不只有“把晶体管做小”这一条路可以走。

摩尔定律走了半个多世纪，现在华为说：咱们换个玩法。

 

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